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CAT24AA01, CAT24AA02
BUS ACTIVITY:
MASTER
S
T
A
R
T
SLAVE
ADDRESS
ADDRESS
BYTE
a7 ÷ a 0
DATA
BYTE
d7 ÷ d0
S
T
O
P
S
P
SLAVE
A
C
K
A
C
K
A
C
K
Figure 6. Byte Write Sequence
SCL
SDA
8th Bit
Byte n
ACK
tWR
STOP
CONDITION
Figure 7. Write Cycle Timing
START
CONDITION
ADDRESS
BUS ACTIVITY: S
T
A
MASTER R
T
SLAVE
ADDRESS
ADDRESS
BYTE
DATA
BYTE
n
DATA
BYTE
n+1
DATA
BYTE
n+x
S
T
O
P
S
P
SLAVE
A
C
K
A
C
K
A
C
K
A
C
K
A
C
K
n =1
x v 15
Figure 8. Page Write Sequence
ADDRESS
BYTE
DATA
BYTE
1
8
9
1
8
SCL
SDA
a 7
a 0
d 7
d 0
t SU:WP
WP
t HD:WP
Figure 9. WP Timing
http://onsemi.com
6
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